基于FPGA的CMI編解碼設計

趙曉東 程煜洋 左磊 方圓

摘? 要：在基于FPGA的基帶傳輸系統研究中，對基帶傳輸信號的碼型有嚴格的要求。通過對CMI碼型的研究，提出了一種通過Altera公司Cyclone Ⅱ系列EP2C35F672C6芯片實現CMI編解碼功能的方法，并給出了Quartus Ⅱ仿真平臺實現CMI編解碼的設計方案。通過這種方法得出的CMI編解碼碼型符合編解碼原理，解碼輸出與基帶信號一致，最終結果符合預期。能夠適應多種集成電子電路設計場合，通過仿真幫助達到預期效果。

關鍵詞：FPGA;CMI;編解碼

Abstract：In the research of baseband transmission system based on FPGA，there are strict requirements for the code type of baseband transmission signal. Through the research of CMI code type，a method to realize CMI coding and decoding function through Alteras Cyclone Ⅱ series EP2C35F672C6 chip is proposed，and the design scheme of Quartus Ⅱ simulation platform to realize CMI coding and decoding is given. The CMI codec pattern obtained by this method accords with the principle of CODEC，the decoding output is consistent with the baseband signal and the final result meets the expectations. It can adapt to a variety of integrated electronic circuit design occasions，and help achieve the desired effect through simulation.

Keywords：FPGA;CMI;CODEC（coder-decoder）

0? 引? 言

隨著科技的快速發展，電子計算機、大規模集成電路、超大規模集成電路以及微處理器技術的迅猛發展?；鶐鬏斚到y設計成為了必要。在集成電路領域中，FPGA器件是超大規模、超高速的可編程邏輯器件，由于其具有高集成度、高速、可編程、硬件描述語言的可修改性、低功耗、開發周期短、硬件與軟件并行性等優點而被廣泛應用。文獻[1]針對數字光纖通信傳輸信號碼型的要求，提出了一種基于可編程邏輯器件EPM240T100C5實現CMI編解碼的方法。文獻[2]介紹了一種新的編程思路實現CMI編碼，在Max+ Plus Ⅱ開發平臺上使用VHDL編程實現CMI編碼，并得到仿真波形。文獻[3]針對LDPC碼進行了兩種算法的設計，一種是直接基于校驗矩陣進行遞歸求取，另一種則通過部分生成矩陣進行設計，并對兩種架構分別進行設計、分析和比較。文獻[4]研究了八路視頻信號傳輸中數字復分接的設計和反向數據信號傳輸中線路碼的編解碼設計。在文獻[5]中，研究者設計出一種將數字化信號的傳輸和光纖通信結合到一起的方案，通過串并轉換及CMI編碼后，經過光纖將信號傳輸到光接收端。文獻[6]對FPGA的數據采集與處理技術進行研究，基于FPGA在數據采樣控制和信號處理方面的高性能和單片系統發展的新熱點，把FPGA作為整個數據采集與處理系統的控制核心。在文獻[7]中，研究者完成了FPGA器件之間以及與其他同類器件性能上的比較，并對分析結果給出了相應的建議。文獻[8]、[9]中，研究者提出包括物理層、傳輸層以及應用層在內的光纖數據傳輸模型，在此基礎上設計光纖傳輸協議，確定光纖傳輸幀格式和數據編碼規則。CMI編碼作為一種容易實現、有恒定的直流分量、頻帶寬等特點在工程中被廣泛應用。筆者所在實驗室基于2020北京市大學生科學研究與創業行動計劃項目，結合當前與專業相關的問題，開展了基于FPGA的基帶傳輸系統的相關研究。本文在前人不同設計思想的基礎上，面向實際應用的需求，將CMI編碼用FPGA器件實現，并進行仿真和驗證。

1? CMI編解碼原理

CMI碼全稱為Code Mark Inversion，它是一種二電平的不歸零1B2B碼型（一位二元信息，二位二元碼元），與數字雙相碼類似，其中的二電平分別為“0”和“1”，簡稱反轉碼。CMI碼在編碼時輪流使用正電平“11”和負電平“00”來表示“1”;用固定相位的一個方波“01”來表示“0”?！?0”為禁用碼組，不會出現三個以上的連碼，這種方式使得CMI碼碼流中可以包含大量的可提取的定時信號，而且易于進行錯誤檢查，也易于實現。在光纖通信中，光源只能發出正的光脈沖，而簡單的二電平碼信息流中“0”“1”的組合情況會造成起伏，造成判決出現問題，此時CMI碼就非常適用。

2? CMI編解碼系統設計

CMI編解碼系統設計方框圖如圖1所示。由圖1可見，系統包括分頻器、偽隨機序列發生器、CMI編碼、CMI解碼四個模塊。

分頻器：由于CMI碼元速率是基帶信號的兩倍，所以采用二分頻模塊來進行分頻。該模塊輸入信號為時鐘信號和異步復位信號，復位信號高電平有效，時鐘信號上升沿觸發，輸出信號為分頻時鐘信號。

偽隨機序列發生器：特征多項式使用f（x）=1+x2+x3，生成周期為7的偽隨機二值序列。采用線性移位寄存器來產生。電路在適當的時鐘信號控制下工作，上升沿觸發，其中設置了reset端，reset高電平時電路異步復位。

CMI編碼：當輸入的碼流為‘0碼時，輸出的碼流為“01”，當輸入的碼流為‘1時，設置一個標志位flag，使得flag<=‘0，輸出“11”，然后將標志位置1，即flag<= ‘1，當接下來的碼流依舊為‘1時，此時輸出為“00”，flag<=‘0。通過標志位的設立，來達到輸入為‘1時，輸出“00”“11”碼流交替出現。輸出都是采用二位二進制代碼輸出。根據CMI編碼的原理可知，CMI碼元的速率為基帶信號的兩倍，所以通過對基帶信號的二分頻方式來使得編碼模塊和其他模塊工作在同一個系統中。

CMI解碼：解碼電路相對于編碼就比較簡單一些，因為無須檢測變化系數，由于輸入是來自上一個模塊的編碼電路，輸入是二位二進制代碼，因此不用對輸入的碼流進行分割。當解碼電路的輸入為“00”或“11”時，輸出為‘1。當輸入為“01”時，輸出為‘0。

3? 系統實現

本系統以Altera公司旗下的Quartus Ⅱ軟件作為開發平臺，采用的FPGA芯片為Cyclone Ⅱ系列EP2C35F672C6，時鐘周期設置為10 kHz。

系統頂層設計原理圖如圖2所示，其中生成的偽隨機序列作為基帶信號分別經CMI編碼模塊和CMI解碼模塊輸出。

3.1? 偽隨機序列發生器

3.2? CMI編碼實現

在CMI編解碼設計中，輸入為偽隨機序列發生器，編碼根據輸入的信號，將它轉換成1B2B的CMI碼，并以二位二進制的形式顯示出來，然后解碼根據同步時鐘對編碼的輸出進行解碼，還原成我們輸入的基帶信號，部分VHDL源代碼為：if（clk'event and clk='1' ）then

4? CMI編解碼系統仿真結果

將Quartus Ⅱ開發工具與ModelSim-Altera仿真軟件相結合，對CMI編解碼系統進行仿真。在測試文件testbench中，設置輸入時鐘clk周期為0.1 ms，設置reset復位信號初始為高電平持續20 ns后變為低電平。仿真結果如圖3所示。

由圖3可知，偽隨機序列輸入的基帶信號m_out從clk_2信號的上升沿讀取，每隔一個時鐘周期采取一次，結果為1 0 1 1 1 0 0，周期為7。CMI編碼的輸出為00 01 11 00 11 01 01，CMI解碼輸出為1 0 1 1 1 0 0，與基帶信號是一致的，保證解碼的正確性。解碼輸出與偽隨機序列相比延時0.3 ms。

5? 結? 論

本設計基于Altera公司的Quartus Ⅱ軟件開發平臺和ModelSim-Altera仿真實驗平臺，使用FPGA器件EP2C35F 672C6芯片，利用VHDL硬件描述語言完成了CMI編解碼電路的設計與仿真。本系統是由許多獨立的可編程邏輯模塊組成，邏輯模塊之間通過頂層設計連接，具有邏輯單元靈活、集成度高、適用范圍廣等優點。在集成電子電路工程上具有一定的應用價值。

參考文獻：

[1] 陳適，綦曉華.基于CPLD的CMI編解碼電路的設計與實現 [J].武漢理工大學學報（信息與管理工程版），2010，32（1）：8-11.

[2] 李莉.基于CPLD/FPGA的CMI編碼設計與實現 [J].現代電子技術，2010，33（11）：86-87.

[3] 郝曉博.LDPC編譯碼器的實現 [D].成都：電子科技大學，2019.

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[6] 孔利東.基于FPGA的數據采集與處理技術的研究 [D].武漢：武漢理工大學，2007.

[7] 包晗.FPGA器件的應用研究 [D].大連：大連海事大學，2006.

[8] 沙啟迪.基于FPGA的光纖通信數據傳輸技術研究 [D].哈爾濱：哈爾濱工業大學，2015.

[9] 李亮.基于FPGA的高速光纖通信數據傳輸技術的研究與實現 [D].長春：吉林大學，2017.

作者簡介：趙曉東（2000—），男，漢族，寧夏石嘴山人，本科在讀，研究方向：通信工程;程煜洋（2000—），女，漢族，湖北武漢人，本科在讀，研究方向：通信工程;左磊（2000—），男，穿青人，貴州畢節人，本科在讀，研究方向：通信工程;方圓（1999—），女，漢族，福建福州人，本科在讀，研究方向：通信工程。